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Des QCM courts par chapitre, avec XP maximale au premier essai et correction détaillée après la bonne réponse.
Quiz
37
Faits
0
Questions
216
Exigences, scénarios, contrôles et critères de fin.
Structure, horloge, reset, stimuli, contrôles et verdict final.
Tableaux dynamiques, queues et index associatifs.
Objets, handles, héritage et méthodes virtuelles.
Contraintes, distributions, erreurs et reproductibilité.
fork, événements, mailboxes et sémaphores.
Driver, monitor, référence et scoreboard.
Contrôles locaux et synchrones, reset, X/Z et actions d'échec.
Coverpoints, bins, croisements et fermeture.
Environnement complet, phases, vidange, configuration, interfaces virtuelles, callbacks et factory.
Setup, hold, slack, chemin critique, contraintes de timing.
Architecture Zynq, communication PS-PL via AXI, design embarqué.
SAR ADC, DAC R-2R, comparateur et séquencement numérique.
Raisonner avec les fronts, les références et les retours.
Adapter les lignes et préserver les paires.
Préparer les couches et les sorties d'un boîtier dense.
Gérer la frontière entre la carte et l'extérieur.
Mettre sous tension et isoler un défaut sans improviser.
Bus mémoire-mappé ARM AMBA : 5 canaux, bursts, IDs, handshake VALID/READY.
Variante simplifiée d'AXI : transactions mot à mot, pas de burst, idéale pour les registres.
Variante streaming d'AXI : un seul canal, pas d'adresse, pour DSP / vidéo.
PS, PL, familles Zynq et répartition entre logiciel et matériel.
Block Design, adresses, validation et export XSA.
Plateforme, BSP, xparameters et pilotes GPIO.
APU, RPU, OCM, TCM, DDR et cohérence des caches.
Ports AXI, contrôle, DMA, horloges, resets et interruptions.
Plateforme, domaine, BSP et niveaux de pilotes.
Source, GIC, ISR et latence.
Buffers, cohérence de cache et sections ELF.
BootROM, FSBL, U-Boot et BOOT.BIN.
ILA, débogueur logiciel et cross-trigger.
Registres, packaging et pilote.
Noyau, Device Tree, GPIO et DMA.
Agents, transactions et vérification du protocole.
Plateforme, BSP, compilation et exécution sur la carte.